Use stxa_sync() when accessing the LSU control register to avoid undefined
behaviour.
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fd2ee897e4
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fac409f6bf
@ -53,11 +53,11 @@ watch_phys_set_mask(vm_offset_t pa, u_long mask)
|
||||
{
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||||
u_long lsucr;
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||||
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||||
stxa(AA_DMMU_PWPR, ASI_DMMU, pa & (((2UL << 38) - 1) << 3));
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||||
stxa_sync(AA_DMMU_PWPR, ASI_DMMU, pa & (((2UL << 38) - 1) << 3));
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||||
lsucr = ldxa(0, ASI_LSU_CTL_REG);
|
||||
lsucr = ((lsucr | LSU_PW) & ~LSU_PM_MASK) |
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||||
(mask << LSU_PM_SHIFT);
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||||
stxa(0, ASI_LSU_CTL_REG, lsucr);
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||||
stxa_sync(0, ASI_LSU_CTL_REG, lsucr);
|
||||
return (0);
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||||
}
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||||
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||||
@ -92,7 +92,7 @@ watch_phys_get(int *bm)
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||||
void
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||||
watch_phys_clear()
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||||
{
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||||
stxa(0, ASI_LSU_CTL_REG,
|
||||
stxa_sync(0, ASI_LSU_CTL_REG,
|
||||
ldxa(0, ASI_LSU_CTL_REG) & ~LSU_PW);
|
||||
}
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||||
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||||
@ -108,11 +108,11 @@ watch_virt_set_mask(vm_offset_t va, u_long mask)
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||||
{
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||||
u_long lsucr;
|
||||
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||||
stxa(AA_DMMU_VWPR, ASI_DMMU, va & (((2UL << 41) - 1) << 3));
|
||||
stxa_sync(AA_DMMU_VWPR, ASI_DMMU, va & (((2UL << 41) - 1) << 3));
|
||||
lsucr = ldxa(0, ASI_LSU_CTL_REG);
|
||||
lsucr = ((lsucr | LSU_VW) & ~LSU_VM_MASK) |
|
||||
(mask << LSU_VM_SHIFT);
|
||||
stxa(0, ASI_LSU_CTL_REG, lsucr);
|
||||
stxa_sync(0, ASI_LSU_CTL_REG, lsucr);
|
||||
return (0);
|
||||
}
|
||||
|
||||
@ -147,7 +147,7 @@ watch_virt_get(int *bm)
|
||||
void
|
||||
watch_virt_clear()
|
||||
{
|
||||
stxa(0, ASI_LSU_CTL_REG,
|
||||
stxa_sync(0, ASI_LSU_CTL_REG,
|
||||
ldxa(0, ASI_LSU_CTL_REG) & ~LSU_VW);
|
||||
}
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||||
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||||
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