Use the pin number rather than the hybrid pin number + name.
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ee2618962b
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73bbe8c584
@ -59,11 +59,11 @@ EEInit(void)
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AT91PS_PIO pPio = (AT91PS_PIO)AT91C_BASE_PIOA;
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AT91PS_PMC pPMC = (AT91PS_PMC)AT91C_BASE_PMC;
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pPio->PIO_ASR = AT91C_PA25_TWD | AT91C_PA26_TWCK;
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pPio->PIO_PDR = AT91C_PA25_TWD | AT91C_PA26_TWCK;
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pPio->PIO_ASR = AT91C_PIO_PA25 | AT91C_PIO_PA26;
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pPio->PIO_PDR = AT91C_PIO_PA25 | AT91C_PIO_PA26;
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pPio->PIO_MDDR = ~AT91C_PA25_TWD;
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pPio->PIO_MDER = AT91C_PA25_TWD;
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pPio->PIO_MDDR = ~AT91C_PIO_PA25;
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pPio->PIO_MDER = AT91C_PIO_PA25;
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pPMC->PMC_PCER = 1u << AT91C_ID_TWI;
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@ -2311,7 +2311,7 @@ typedef struct _AT91S_BFC {
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// ========== Register definition for BFC peripheral ==========
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#define AT91C_BFC_MR ((AT91_REG *) 0xFFFFFFC0) // (BFC) BFC Mode Register
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#include <at91/at91_pio_rm9200.h>
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#include <at91/at91_pioreg.h>
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// *****************************************************************************
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// PERIPHERAL ID DEFINITIONS FOR AT91RM9200
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@ -188,8 +188,8 @@ _init(void)
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AT91C_BASE_PIOC->PIO_PDR = 0xffff0000;
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#endif
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// Configure DBGU -use local routine optimized for space
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AT91C_BASE_PIOA->PIO_ASR = AT91C_PA31_DTXD | AT91C_PA30_DRXD;
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AT91C_BASE_PIOA->PIO_PDR = AT91C_PA31_DTXD | AT91C_PA30_DRXD;
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AT91C_BASE_PIOA->PIO_ASR = AT91C_PIO_PA31 | AT91C_PIO_PA30;
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AT91C_BASE_PIOA->PIO_PDR = AT91C_PIO_PA31 | AT91C_PIO_PA30;
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pUSART->US_IDR = (unsigned int) -1;
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pUSART->US_CR =
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AT91C_US_RSTRX | AT91C_US_RSTTX | AT91C_US_RXDIS | AT91C_US_TXDIS;
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@ -58,11 +58,11 @@ InitEEPROM(void)
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AT91PS_PIO pPio = (AT91PS_PIO)AT91C_BASE_PIOA;
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AT91PS_PMC pPMC = (AT91PS_PMC)AT91C_BASE_PMC;
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pPio->PIO_ASR = AT91C_PA25_TWD | AT91C_PA26_TWCK;
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pPio->PIO_PDR = AT91C_PA25_TWD | AT91C_PA26_TWCK;
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pPio->PIO_ASR = AT91C_PIO_PA25 | AT91C_PIO_PA26;
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pPio->PIO_PDR = AT91C_PIO_PA25 | AT91C_PIO_PA26;
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pPio->PIO_MDDR = ~AT91C_PA25_TWD;
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pPio->PIO_MDER = AT91C_PA25_TWD;
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pPio->PIO_MDDR = ~AT91C_PIO_PA25;
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pPio->PIO_MDER = AT91C_PIO_PA25;
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pPMC->PMC_PCER = 1u << AT91C_ID_TWI;
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@ -85,24 +85,24 @@ EMAC_SetMACAddress(unsigned char mac[6])
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AT91C_BASE_PMC->PMC_PCER = 1u << AT91C_ID_EMAC;
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AT91C_BASE_PIOA->PIO_ASR =
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AT91C_PA14_ERXER | AT91C_PA12_ERX0 | AT91C_PA13_ERX1 |
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||||
AT91C_PA8_ETXEN | AT91C_PA16_EMDIO | AT91C_PA9_ETX0 |
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||||
AT91C_PA10_ETX1 | AT91C_PA11_ECRS_ECRSDV | AT91C_PA15_EMDC |
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||||
AT91C_PA7_ETXCK_EREFCK;
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AT91C_PIO_PA14 | AT91C_PIO_PA12 | AT91C_PIO_PA13 |
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||||
AT91C_PIO_PA8 | AT91C_PIO_PA16 | AT91C_PIO_PA9 |
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||||
AT91C_PIO_PA10 | AT91C_PIO_PA11 | AT91C_PIO_PA15 |
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||||
AT91C_PIO_PA7;
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||||
AT91C_BASE_PIOA->PIO_PDR =
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||||
AT91C_PA14_ERXER | AT91C_PA12_ERX0 | AT91C_PA13_ERX1 |
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||||
AT91C_PA8_ETXEN | AT91C_PA16_EMDIO | AT91C_PA9_ETX0 |
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||||
AT91C_PA10_ETX1 | AT91C_PA11_ECRS_ECRSDV | AT91C_PA15_EMDC |
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||||
AT91C_PA7_ETXCK_EREFCK;
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||||
AT91C_PIO_PA14 | AT91C_PIO_PA12 | AT91C_PIO_PA13 |
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||||
AT91C_PIO_PA8 | AT91C_PIO_PA16 | AT91C_PIO_PA9 |
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||||
AT91C_PIO_PA10 | AT91C_PIO_PA11 | AT91C_PIO_PA15 |
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||||
AT91C_PIO_PA7;
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||||
#if defined(BOOT_KB920X) | defined(BOOT_BWCT) /* Really !RMII */
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||||
AT91C_BASE_PIOB->PIO_BSR =
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||||
AT91C_PB12_ETX2 | AT91C_PB13_ETX3 | AT91C_PB14_ETXER |
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||||
AT91C_PB15_ERX2 | AT91C_PB16_ERX3 | AT91C_PB17_ERXDV |
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||||
AT91C_PB18_ECOL | AT91C_PB19_ERXCK;
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||||
AT91C_PIO_PB12 | AT91C_PIO_PB13 | AT91C_PIO_PB14 |
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||||
AT91C_PIO_PB15 | AT91C_PIO_PB16 | AT91C_PIO_PB17 |
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||||
AT91C_PIO_PB18 | AT91C_PIO_PB19;
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||||
AT91C_BASE_PIOB->PIO_PDR =
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||||
AT91C_PB12_ETX2 | AT91C_PB13_ETX3 | AT91C_PB14_ETXER |
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||||
AT91C_PB15_ERX2 | AT91C_PB16_ERX3 | AT91C_PB17_ERXDV |
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||||
AT91C_PB18_ECOL | AT91C_PB19_ERXCK;
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||||
AT91C_PIO_PB12 | AT91C_PIO_PB13 | AT91C_PIO_PB14 |
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||||
AT91C_PIO_PB15 | AT91C_PIO_PB16 | AT91C_PIO_PB17 |
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||||
AT91C_PIO_PB18 | AT91C_PIO_PB19;
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||||
#endif
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||||
pEmac->EMAC_CTL = 0;
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@ -134,17 +134,17 @@ AT91F_MCI_CfgPIO(void)
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// Configure PIO controllers to periph mode
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||||
AT91F_PIO_CfgPeriph(
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||||
AT91C_BASE_PIOA, // PIO controller base address
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||||
((unsigned int) AT91C_PA28_MCCDA ) |
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||||
((unsigned int) AT91C_PA29_MCDA0 ) |
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||||
((unsigned int) AT91C_PA27_MCCK ), // Peripheral A
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||||
((unsigned int) AT91C_PIO_PA28 ) |
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||||
((unsigned int) AT91C_PIO_PA29 ) |
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||||
((unsigned int) AT91C_PIO_PA27 ), // Peripheral A
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||||
0); // Peripheral B
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||||
// Configure PIO controllers to periph mode
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||||
AT91F_PIO_CfgPeriph(
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||||
AT91C_BASE_PIOB, // PIO controller base address
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||||
0, // Peripheral A
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||||
((unsigned int) AT91C_PB5_MCDA3 ) |
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||||
((unsigned int) AT91C_PB3_MCDA1 ) |
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||||
((unsigned int) AT91C_PB4_MCDA2 )); // Peripheral B
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||||
((unsigned int) AT91C_PIO_PB5 ) |
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||||
((unsigned int) AT91C_PIO_PB3 ) |
|
||||
((unsigned int) AT91C_PIO_PB4 )); // Peripheral B
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||||
}
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@ -223,10 +223,10 @@ SPI_InitFlash(void)
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// enable CS0, CLK, MOSI, MISO
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pPio = (AT91PS_PIO)AT91C_BASE_PIOA;
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pPio->PIO_ASR = AT91C_PA3_NPCS0 | AT91C_PA1_MOSI | AT91C_PA0_MISO |
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||||
AT91C_PA2_SPCK;
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||||
pPio->PIO_PDR = AT91C_PA3_NPCS0 | AT91C_PA1_MOSI | AT91C_PA0_MISO |
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||||
AT91C_PA2_SPCK;
|
||||
pPio->PIO_ASR = AT91C_PIO_PA3 | AT91C_PIO_PA1 | AT91C_PIO_PA0 |
|
||||
AT91C_PIO_PA2;
|
||||
pPio->PIO_PDR = AT91C_PIO_PA3 | AT91C_PIO_PA1 | AT91C_PIO_PA0 |
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||||
AT91C_PIO_PA2;
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||||
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// enable clocks to SPI
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||||
AT91C_BASE_PMC->PMC_PCER = 1u << AT91C_ID_SPI;
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